Die DLX-Pipeline ist eine 5-stufige Pipeline für RISC-Prozessoren (beispielsweise MIPS), welche dem DLX-Mikroprozessor entstammt. Die Stufen heißen: Das Design der DLX-Pipeline verhindert das Auftreten von Schreibe-nach-Lese- (write after read) und Schreibe-nach-Schreibe-Konflikten (write after write). Lese-nach-Schreibe-Konflikte (read after wr...